逻辑运算设计,四个人的投票表决器,求表达式?
真值表
由真值表,我们可以知道:
F=ABCD+ABC+ABD+AB+ACD+AC+AD+BCD
化简可得:
F=AB+AC+AD+BCD
这就是我们的逻辑函数表达式了
4人表决器表决器好设计,用5个三输入的与非门就行了,五人表决器就要麻烦了,真值表好列,用逻辑代数或卡诺图求出简化的逻辑表达式并演化成与非的形式就不好化了,这个问题你还是想老师寻求一点帮助吧
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity bj is
port(a:in std_logic_vector(4 downto 0);
y:out std_logic);
end bj;
architecture aa of bj is
signal x:std_logic; begin
x<=a(0)+a(1)+a(2)+a(3)+a(4);
process(a) begin
if x>2 then y<=’1’;
else y<=’0’;
end if;
end process;
end aa;
#include
sbit P10=P1^0;//表决人1
sbit P11=P1^1;//表决人2
sbit P12=P1^2;//表决人3
sbit P13=P1^3;//表决人4
sbit P14=P1^4;//表决人5
sbit P15=P1^5;//结果显示
int a=0;
int b=0;
int i=0;
void main()
{
while(1)
{
if(P10==0)
a++;
else
b++;
if(P11==0)
a++;
else
b++;
if(P12==0)
a++;
else
b++;
if(P13==0)
a++;
else
b++;
if(P14==0)
a++;
else
b++;
if(a>b)
P15=0;
else
P15=1;
a=b=0;
for(i=0;i<255;i++)
{}
}
}
两个条件并集,
if 结果字符数量>2, or 结果字符数量为2包含A
than 通过,
else 不通过。
列出真值表→得到输出逻辑表达式→化简(或直接由真值表采用卡诺图化简)→画出逻辑图。
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东胜区19658134735: 用与非门设计一个四人表决电路?
店滕三鞭: <p>设三个人 为ABC ,董事长为 D , 输出为P.给个图你看吧, 我也是学习,</p> <p></p>
东胜区19658134735: 请设计一个四输入多数表决电路:当4个输入端有3个或3个以上为1时,输出为1,否则输出为0,只写逻辑表达式 - ?
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东胜区19658134735: 试设计一个裁判表决器,(要求用组合逻辑电路设计) - ?
店滕三鞭: 假设A,B,C为组合逻辑的输入,Y为判决结果的输出,根据条件可以得出下面的逻辑表达式: Y=AB+AC+ABC;化简后得:Y=AB+AC 用两个二输入与门和一个二输入或门即可实现,具体接法: 第一个与门输入A和B,第二个与门输入A和C,两个与门的输出分别接或门的两个输入端,或门的输出即为判决结果的输出.
东胜区19658134735: 数字逻辑电路课程设计 八人表决器 表决器电路设计 急急急!!!! - ?
店滕三鞭: 总体设计:每人2个开关(同意、签到,签到不同意即为反对),输出3个灯(通过、否决、再议). 实现方法: 1、组合电路:16变量3输出组合逻辑设计,计算量太大,不嫌烦就慢慢算. 2、时序电路:两个8路可预置移位寄存器(通过、签到),锁存投票状态后移位输出至2个计数器,通过数大于3亮通过灯,签到数小于6亮再议灯,亮灯都不亮就亮否决灯. 3、逻辑阵列:用PLD、GAL都行,16路输入3路输出,编好逻辑写进去就行,就是不知道老师会不会咬你.
东胜区19658134735: 用PLC设计一个8人表决器 当有大于4个人同意时绿灯亮 刚好4个人时黄灯亮 小于4个人时红灯亮 要PLC图和梯形 - ?
店滕三鞭: PLC接线图:X0、X1、X2、X3、X4、X5、X6、X7接8个表决器触点 X10接选钮开关(接通时表决有效 Y0接红灯、Y1接黄灯、Y2接绿灯 梯形图:LDIX10 FNC40ZRSTY0:Y3 LDPX10 ORFX10 ZRST M0:M7 RST D0 LDX10 FNC27 WOR K2X0 K2M0 K2M0FNC43 SUM K2M0 D0 FNC10 CMP K4 Y0
东胜区19658134735: 3、四人表决器输入共有种组合 - 上学吧普法考试?
店滕三鞭:[答案] library ieee; use ieee.std_logic_1164.all; entity qrbjq is port( a:in std_logic_vector(6 downto 0); --7个人 num:buffer integer range 0 to 7; --表决通过人数 co:out std_logic); --是否通过信号 end; architecture art of qrbjq is begin process(a) variable b:...
东胜区19658134735: 组合逻辑电路设计一个三人表决器,当表决某一提案时,只要两个人以上 ?
店滕三鞭: 三人表决,两人以上同意则为通过,应该包含二人同意,否则就是只要有一人反对则不能通过;因为没有弃权选项,所以简单; 表决通过按钮按动时输出一个高电平,用三个两输入端与门,每个与门的两输入端均与其他两个与门的一个输入端并联,构成三个输入端,分别接通表决按钮,三个与门输出端连入一个三输入或门,或门输出端接通过显示; 当三个输入端任意两个或三个同时处于高电平时,总有一个或三个与门输出高电平,使得其后的或门输出高电平,驱动显示表决通过.