如何用74LS42、74LS283组成编码器？
74LS42的功能是：十进制译码器；74LS283的功能是：四位二进制超前进位全加器。
可以使用单个74ls148芯片的简化真值表和32行5行优先编码器的简化真值表，找出每个块74ls148和74ls148的每个32-5行优先编码器输出和每个块的 yex 之间的关系。使用74lsl148的选通输入 s，选通输出 ys 和扩展 yex，四个74ls148芯片可以形成32-5线的优先编码器。
使能输入端(Enable Inputs)：
在中规模集成电路中经常会碰到使能端（Enable Pin），使能端可以是输入，也可以是输出，其是用来扩展中规模集成电路功能的输入/输出端，下图a是一个2输入译码器上加上一个输入E，由于输入端E的加入。
其功能发生了变化,当E=0时,其输出全部为0,而该译码器在没有加上E端时,其为高电平有效,这时其输出端没有一个处于有效工作状态。
我们可以理解为E=0时，该译码器不工作；当E=1时，我们看到，其译码器可以正常工作，我们把这种输入端在E=1时能正常工作的使能端叫做高电平有效。下图b为其简化的逻辑符号。
用74ls160做42位计数器,求给个图
42位计数器还没办法画图，那需要42个74LS160。应该是要用74ls160做42进制的计数器吧，最大数是41。下图是仿真图，是计数到最大数41时的截图。那两个数码管，你不用画，是用来显示仿真效果的。
常见的集成电路芯片有哪些?
74LS42 BCD TO DECIMAL BCD转十进制译码器74LS48 BCD-7 SEG BCD-7段译码器74LS49 BCD-7 SEG BCD-7段译码器74LS51 AND OR GATE INVERTER 与或非门74LS540 OCT Buffer\/Line Driver 8路缓冲驱动器74LS541 OCT Buffer\/LineDriver 8路缓冲驱动器74LS74 D-TYPE FLIP-FLOP D型触发器74LS682 8BIT ...
急!74ls138译码器与74LS48译码驱动器在功能上有什么不同
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74ls160原件功能,各引脚功能,请详细介绍,在线等!
jiaojian611135 采纳率:54% 擅长: 电脑外接设备 其他编程语言 手机使用 MP4\/MP3 魔兽争霸 为您推荐: 74ls192引脚图及功能 数码管引脚图 74LS194 74LS86引脚图 74LS00实际引脚 74LS42 74LS08 4511引脚图及功能 74ls112引脚图及功能 74LS75引脚 其他类似问题2013...
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下面是74LS49的VHDL描述,74LS49就是一个驱动共阴极数码管的译码器:LIBRARY IEEE;USE IEEE.Std_logic_1164.ALL;ENTITY ls49 IS PORT(bl_n:IN Std_logic; bi:IN Std_logic_vector(3 DOWNTO 0); a,b,c,d,e,f,g:OUT Std_logic);END ls49;ARCHITECTURE behave_49 OF ls49 ISSIGNAL s:Std_logic_...
74LS42、74LS283功能是什么?
74LS42的功能是：十进制译码器；74LS283的功能是：四位二进制超前进位全加器。译码器(decoder)是一类多输入多输出组合逻辑电路器件，其可以分为:变量译码和显示译码两类。 变量译码器一般是一种较少输入变为较多输出的器件，常见的有n线-2^n线译码和8421BCD码译码两类;显示译码器用来将二进制数转换...
如何用74LS42、74LS283组成编码器?
74LS42的功能是：十进制译码器；74LS283的功能是：四位二进制超前进位全加器。可以使用单个74ls148芯片的简化真值表和32行5行优先编码器的简化真值表，找出每个块74ls148和74ls148的每个32-5行优先编码器输出和每个块的 yex 之间的关系。使用74lsl148的选通输入 s，选通输出 ys 和扩展 yex，四个...
74LS42是什么芯片
74LS42的功能是：十进制译码器；74LS283的功能是：四位二进制超前进位全加器。可以使用单个74ls148芯片的简化真值表和32行5行优先编码器的简化真值表，找出每个块74ls148和74ls148的每个32-5行优先编码器输出和每个块的 yex 之间的关系。使用74lsl148的选通输入 s，选通输出 ys 和扩展 yex，四个...
74hc42译码器的功能
74LS42的功能是：十进制译码器；74LS283的功能是：四位二进制超前进位全加器。可以使用单个74ls148芯片的简化真值表和32行5行优先编码器的简化真值表，找出每个块74ls148和74ls148的每个32-5行优先编码器输出和每个块的 yex 之间的关系。使用74lsl148的选通输入 s，选通输出 ys 和扩展 yex，四个...
扈耍奥贝： 四位循环码? 是余三码. 用 74LS283,把四位二进制数,加上3,即成四位循环码.
晋中市19587106463： 设计一个一位余3码的加法电路,选用四位二进制加法器74ls283 - ？
扈耍奥贝： 这很简单,用两个74ls283和一个四位二进制计数器,第一个74ls283四个输出端接接第二个74ls283输入端a1,a2,a3,a4,将第二个四位二进制计数器调成Q1,Q2,Q3,Q4,分别为0011既3了,并将其对应接到74ls283另四个输入端b1,b2,b3,b4,这样第一个74ls283运算时第二个74ls283就是对应的余3码了.
晋中市19587106463： 74LS283如何实现级联? - ？
扈耍奥贝： 1.登录主路由器的管理界面 2.找到dhcp服务并打开(如果没有打开这项服务,登录管理界面前请自己给电脑设定IP地址) 3.登录副路由器的管理界面,找到LAN设定,修改一下IP地址(前两段要一样,最好不要和主路由器的IP地址一样,因为会产生冲突) 4.路由器重启后以新的IP地址登录副路由器,找到WAN上网设定,将上网设定改成自动获取IP 5.最后用一条网线连接主路由器的LAN端口和副路由器的WAN端口 6.副路由器管理主界面提示已连接后测试上网,可以上网即可.
晋中市19587106463： 问:用并行4位全加速器74LS283实现下列代码转化,控制信号C=0时8421BCD码转化成余三码 - ？
扈耍奥贝： 74LS283是四位二进制加法运算器. 8421BCD码加3(0011)得到余三码,用283很容易实现. 余三码减去3得到8421BCD码,直接用283不能实现减法运算.想想带符号数减法运算的处理方法,或观察一下能否将余三码加上某数得到8421BCD码?
晋中市19587106463： 利用74LS283实现Y=3X.其中X是不大于5的3位二进制数.要求用两个数码管显示运算结果,求电路图, - ？
扈耍奥贝：[答案] 需要用两片 283,还要用与门、或门、译码器芯片.
晋中市19587106463： 【求助】使用74LS283构成4位二进制全加\全减器后,怎样用Verilog HDL进行仿真 - ？
扈耍奥贝： 定义输入输出端口,选择矢量波形仿真模式,选中先前定义的端口,设置好输入波形就可以得到仿真结果.
晋中市19587106463： 电子高手请进例如:用74LS283设计一个四位二进制数(A=A3A2A1A0)大小可变的比较器.当控制信号M=0,A≥8时,输出为1;当控制信号M = 1,A≥4时,输... - ？
扈耍奥贝：[答案] 看懂你的意思了,M是控制端,M=1时,判断A与4的比较情况M=0时,判断A与8的比较情况当M = 0时,A ≥8,必定得加1000,即B3B2B1B0 = 1000.当A为8时,要使CO = 1,即输入信号与A之和至少要等于168+8=16,所以必定得加1000,即加8....
晋中市19587106463： 用74LS42设计一个1位全加器怎么设计啊? - ？
扈耍奥贝： 根据全加器真值表,可写出和S,高位进位CO的逻辑函数.A1A0作为两个输入变量,即加数和被加数A、B,D0~D3为第三个输入变量,即低位进位CI,1Y为全加器的和S,2Y全加器的高位进位CO,则可令数据选择器的输入为:A1=A,A0=B,1DO=1D3=CI,1D1=1D2=CI反,2D0=0,2D3=1,2D1=2D2=CI,1Q=S1,2Q=CO;可以根据管脚所对应的连接电路
晋中市19587106463： 74ls283可完成的二进制加法运算的范围是多少 - ？
扈耍奥贝： 一片LS283可以进行4位的二进制加法运算,对于无符号整数,可以进行(0~15)+(0~15)的加法运算,和的范围在0~30之间.对于有符号数,可以进行(-8~+7)+(-8~+7)的加法运算,和的范围在-16~+14之间(将进位标志C4看成是符号位).
晋中市19587106463： 用74LS138设计一个译码电路,分别选4片2864,列出各芯片占的地址空间范围 - ？
扈耍奥贝： 2864的寻址范围是0~8192,74LS138是三八线译码器,分选4片2864,若取前4位译码输出,个芯片的地址空间(假设偏移地址为0x0000)为: 0x0000~0x1FFF; 0x2000~0x3FFF; 0x4000~0x5FFF; 0x6000~0x7FFF.
