逻辑分析中怎么区分 和 与 或的关系?

作者&投稿:诺强 (若有异议请与网页底部的电邮联系)
示波器和逻辑分析仪有什么区别?~

这个问题可以从下面几个角度来回答,希望能帮你解决问题:
从电压等级显示来看,逻辑分析仪只能观察信号的高低电平(逻辑电平),而示波器能观察到信号的具体电压大小;
从输入通道数来看,逻辑分析仪可轻易实现多通道(16或个呢更多)同时测量,方便对并行信号进行分析。而示波器最多也就实现4通道同时测量;
相对来说,逻辑分析仪的应用更偏向于数字电路的时序逻辑分析,并不关注信号本身的波形结构;而示波器虽能测量整个信号的波形,从中分析出信号的异常和干扰,但无法长时间、多通道记录信号的时序逻辑,在分析时序逻辑方面能力较弱。
虽然目前逻辑分析仪和示波器在测试原理上还是差别较大的,但随着电子技术的飞速发展,这两者的功能将会渐渐重合,直至两者合二为一变成一种仪器。

1、两者概念不同
&&是逻辑与:即判断&&两侧的表达式是否都为真,都为真则此&&表达式值为真;
& 是按位与:即将&两侧的数用二进制展开,每一位都求与运算(二进制与运算,跟逻辑与差不多),最后得到的二进制数即为结果;
2、两者结果不同
逻辑与结果只讲真和假,而按位与得出的却是实实在在的一个数。
以一个Verilog测试程序为例,说明两者之间的区别:
module test (CLK, AA, BB, CC, AOUT, BOUT, COUT, DOUT);
input CLK;
input[3:0] AA,BB,CC;
output AOUT,BOUT,COUT,DOUT;
reg AOUT;
reg BOUT;
reg COUT;
reg DOUT;
always @(posedge CLK)//检测时钟上升沿
begin : u1
if (AA && CC && BB)
begin
AOUT<=1'b1 ;
end
else
begin
AOUT<=1'b0 ;
end
end
always @(posedge CLK)//检测时钟上升沿
begin : u2
if (AA & CC & BB)
begin
BOUT<=1'b1 ;
end
else
begin
BOUT<=1'b0 ;
end
end
always @(posedge CLK)//检测时钟上升沿
begin : u3
if ((AA>5) && (CC4))
begin
COUT<=1'b1 ;
end
else
begin
COUT<=1'b0 ;
end
end
always @(posedge CLK)//检测时钟上升沿
begin : u4
if ((AA>5) & (CC4))
begin
DOUT<=1'b1 ;
end
else
begin
DOUT<=1'b0 ;
end
end
endmodule
上面三个always @()中分别用到如下三种if判断表达式
(AA && CC && BB)
(AA & CC & BB)
((AA>5) && (CC4))
((AA>5) & (CC4))


扩展资料:
对这四条表达式进行逻辑分析 :
1、(AA && CC && BB)
逻辑分析:
当AA、BB、CC都为非0数时,表达式为“1”。
怎么判断AA、BB、CC为非“0”,先分析一下为“0”的情况。
当AA为0的时候,AA等于4'b0,即每位都为0,即只需AA的4位矢量之间做一下“逻辑或”运算,AA[3] || AA[2] || AA[1] || AA[0],也可写成(|AA);
当4位矢量中只需有一位不为0,那么AA就必然不为“0”。
整个实现过程就是,先AA、BB、CC各自本身的各位之间做“逻辑或”运算,运算的结果之间做“逻辑与”运算。
2、(AA & CC & BB)
逻辑分析:
表达式(AA & CC & BB)等效为:
((AA[3] & BB[3] & CC[3]) || (AA[2] & BB[2] & CC[2]) ||
(AA[1] & BB[1] & CC[1]) || (AA[0] & BB[0] & CC[0]))
即只需要其中有一个表达式(AA[i] & BB[i] & CC[i]) 不为“0”,则整个结果就为“1” ,i取0到3。
3、((AA>5) && (CC4))
逻辑分析:
表达式(AA>5)、(CC4)结果均为1位的逻辑量,三个逻辑量之间做“逻辑与”。
4、((AA>5) & (CC4))
逻辑分析:
三个一位的逻辑量之间做“逻辑与”和“位与”是等效的。

假设我有一个鸡蛋,你没有
“与”的结果:没鸡蛋(只要有一个没鸡蛋,结果就是没鸡蛋)
“或”的结果:有鸡蛋(只有有一个有鸡蛋,结果就是有鸡蛋)
以此类推,如果不明白,我一鸡蛋砸死你。。。。

和:表示的是串联关系;或:表示的是并联关系。


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