74ls90构成任意进制的计数器的方法如何构成一个100进制的计数器

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求~~~用74ls90设计七进制计数器~

没法传图
先将R91R92接地 然后将输出端q1接到第二个输入端INB构成十进制计数器。然后利用反馈变成七进制。当计数计到七的时候,q4,q3,q2,q1分别输出0111,将这三个输出取与后接到清零端R1R2上,,每当计数到0111的时候计数器就会清零,这时就构成了七进制计数器,输入端INA每输入7个信号,,“与”的输出端就变化一次。

要了解74LS90构成n进制计数器的连接方法建议看看http://www.cqvip.com/qk/80793X/200906/30648798.html很详细 在线看就行

步骤和置数法一样,唯一不同的是,将置零信号接到置零端就ok。74ls163是单时钟同步十六进制计数器,附加有置零和置数功能,时钟作用在上升沿。那么,根据其功能表即可制成八进制计数器。
同步计数器,当译出置数信号时必须等到时钟信号上升沿到来时才能置数,但上升沿到来时计数器又向高一位计数了,所以在0111=7时译出置数信号与进位信号C,将置数信号输出端接至置数端。

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寄存器:
Vcc 2CR 2D 2Ck 2St 2Q -2Q
┌┴—┴—┴—┴—┴—┴—┴┐ 双D触发器74LS74
│14 13 12 11 10 9 8 │
│ 1 2 3 4 5 6 7│
└┬—┬—┬—┬—┬—┬—┬┘
1Cr 1D 1Ck 1St 1Q -1Q GND
Vcc 8Q 8D 7D 7Q 6Q 6D 5D 5Q ALE
┌┴—┴—┴—┴—┴—┴—┴—┴—┴—┴┐ 8位锁存器74LS373
│20 19 18 17 16 15 14 13 12 11│
│ 1 2 3 4 5 6 7 8 9 10│
└┬—┬—┬—┬—┬—┬—┬—┬—┬—┬┘
-OE 1Q 1D 2D 2Q 3Q 3D 4D 4Q GND
参考资料来源:百度百科-74系列引脚图管脚图

当计数达到该进制的树时90管清零。 要构成100进制计数器需要两个90管。 每个管子的2 3 号口接地 第一个管子的11号口接第二个管子的输入端 14号口 便可完成。

计数是一种最简单基本的运算,计数器就是实现这种运算的逻辑电路,计数器在数字系统中主要是对脉冲的个数进行计数,以实现测量、计数和控制的功能

同时兼有分频功能,计数器是由基本的计数单元和一些控制门所组成,计数单元则由一系列具有存储信息功能的各类触发器构成,这些触发器有RS触发器、T触发器、D触发器及JK触发器等。

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在数字系统中,对脉冲的个数进行计 数、以实现数字测量、运算和控制的数字部 件,称为计数器。

计数器主要由触发器构成。若按触发器 的翻转的次序来分类,可以把计数器分为同 步式和异步式。在同步计数器中,当计数脉 冲输入时所有触发器是同时翻转的; 而在异 步计数器中,各级触发器则不是同时翻转 的。

若按计数过程中计数器中数字的增减来 分类,可以分为加法计数器,减法计数器和 可逆计数器(亦称加减计数器)。加法计数器 是随着计数脉冲的不断输入而递增计数的; 减法计数器是随着计数脉冲的不断输入而递 减计数的;可增可减的称可逆计数器。

参考资料来源:百度百科-同步计数器



用74ls161十六进制加法计数器或74ls160加法十进制计数器,74ls190十进制加减计数器或74ls191十六进制加减计数器,若用十进制加法计数器74ls160,用两片级联即可。

每一片LD非接1,rd非接1,第一片s结1,第二片s接第一片的co非 10*10=100,为一百进制计数器,具体看真值表。

两片74LS90都设置成五进制,构成25进制计数器,然后遇24清零。假设两片74LS90是左右摆放,左边设为片1,右边为片2。片1的CPB连接片2的片1的QB与QD与后的结果;片1的QC连接其R0和片2的R0;片2的QD连接其R1端和片1的R1端。其余四个S脚都接零。

扩展资料:

计数器主要由触发器构成。若按触发器 的翻转的次序来分类,可以把计数器分为同 步式和异步式。在同步计数器中,当计数脉 冲输入时所有触发器是同时翻转的; 而在异 步计数器中,各级触发器则不是同时翻转 的。

若按计数过程中计数器中数字的增减来 分类,可以分为加法计数器,减法计数器和 可逆计数器(亦称加减计数器)。加法计数器 是随着计数脉冲的不断输入而递增计数的; 减法计数器是随着计数脉冲的不断输入而递 减计数的;可增可减的称可逆计数器。

参考资料来源:百度百科-同步计数器



74LS90是二-五-十进制异步加法计数器,具有双时钟输入,并具有清零和置数等功能,其引脚排列如图1所示。

图中

R0(1)、R0(2) 为清零端,两者同时为高电平时实现清零功能,清零方式为异步。

R9(1)、R9(2)为置数端,两者同时为高电平时实现置数功能,此时,输出端输出1001。

QD、QC、 Q B、 Q A为数据输出端。 CP1、CP2为脉冲输入端,其中:

脉冲从CP1进去,输出从QA输出时为二进制记数

脉冲从CP2进去,输出从QD、QC、QB输出时为五进制记数 脉冲从CP1进去,QA接CP2,输出从QD、QC、QB、QA输出时为十进制记数,因此,

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74ls90构成任意进制的计数器设计采用反馈清零的方法实现,即从0记到要设计的进制时使清零端 R0(1)、R0(2 有效(同时为高电平),进而反馈清零。

具体的方法是:如需设计n进制计数器,就把n各位BCD码中为“1”的输出端进行“与”运算,结果接到各个74LS90的R0(1)、R0(2)端,即可实现n进制计数。(因为74LS90是异步清零方式,所以设计n进制计数器则需计到n的BCD码才能返回清零,而不是计到n-1就返回,实际上n只会一闪即失,并不能看到)



楼上乱回答, 构成任意进制方法都是一样。 当计数达到该进制的树时90管清零。 要构成100进制计数器需要两个90管。 每个管子的2 3 号口接地 第一个管子的11号口接第二个管子的输入端 14号口 便可完成。 完全手打!

用2个90芯片 按照十进制功能连好,拿其中一个作为个位,将其的QD引出 链接到另外一个90的INTA, 便是100进制的计数器,如果要向高位(百位)的进位, 可以用一个与门电路完成(接在QD和QA),也可以利用下降沿触发完成(接在QD)。


74ls90引脚图及功能详解
4LS90功能:十进制计数器(÷2和÷5)原理说明:本电路是由4个主从触发器和用作除2计数器及计数周期长度为除5的3位2进制计数器所用的附加选通所组成。74LS90功能:十进制计数器(÷2和÷5)原理说明:本电路是由4个主从触发器和用作除2计数器及计数周期长度为除5的3位2进制计数器所用的附加选...

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苍诞腹膜: 第一片74LS90采用10进制计数模式,clka是时钟信号输入端(下降沿有效),Q3、Q2、Q1、Q0是输出8421BCD码,计数值由0(0000)到9(1001).第二片采用5进制计数模式,clkb是时钟输入(下降沿有效),Q3、Q2、Q1是输出(Q0可以不...

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安塞县15193988540: 怎么样用,4片74ls90组成3600进制的计数器?? -
苍诞腹膜: 74ls90计数到8时即产生Q3的电平为高,可将产生的高电平作为脉冲输入至下一级,同时第一级计数器清零;以此类推这样可构成4096进制计数器.在最后一级经过计算可通过计算设置清零,由此进行计数至3600

安塞县15193988540: 只用74LS90实现七进制计数器 -
苍诞腹膜: 这个很简单啊,QA、QB、QC、QD接输出,R9(1)R9(2)其中一个接低电平,另一个随便,然后将输出脚的QA、QB、QC接在一个三输入的与非门的输入端,与非门的输出端接在一个反相器的输入端,反相器的输出端接在R0(1)和R0(2)上面,也就是说,R0(1)和R0(2)短接,这样输出端就可以从0-6的变化了(0000(0) 0001(1) 0010(2) 0011(3) 0100(4) 0101(5) 0110(6) 0111(7)),当输出端的A、B、C同时为1时,与非门输出才为0,反相器输出为1,然后R0(1)和R0(2)同时为1,把输出端置零.这种方法好像叫做什么反馈清零法望采纳

安塞县15193988540: 如何利用74LS90接成12进制计数器? -
苍诞腹膜: CP2接CLK, R0(1), R1(2),S0(1),S0(2)接低电平.输出为QB,QC,QD;其他的就不要接了

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苍诞腹膜: 90是异步清零的 用10清零就行 0-9刚好10个状态 具体接法 cp接cp0 、q0接cp1、 q3和q1分别接r1和r2

安塞县15193988540: 怎么用74ls90接成16进制计数器?上图 -
苍诞腹膜: 一片74ls90最大是10进制计数器,不能接成接成16进制计数器,需要两片才可以.这点麻烦了,用一片74ls161就行了,就是16进制计数器.

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苍诞腹膜: 将 CP1接成高电平,CP2接时钟端,用QdQcQb输出就是000-100(高位为Qd,低位为Qb)

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