JK触发器和D触发器中，RD和SD的作用是什么 ？

JK触发器和D触发器在实现正常逻辑功能时，Rd和Sd应处于什么状态？~

如果是低电平有效就置1，高电平有效就置0，可以利用这两个端来进行联片。
当符号上有非号时，信号是低电平有效，没有非号时，是高电平有效。使用时，总是使得触发器置位端无效。触发器才能正常使用。可以用别的信号加在这两个端上来控制触发器。计数器中联级就是这个方法。
JK触发器具有置0、置1、保持和翻转功能，在各类集成触发器中，JK触发器的功能最为齐全。在实际应用中，它不仅有很强的通用性，而且能灵活地转换其他类型的触发器。

扩展资料：
SD和RD接至基本RS触发器的输入端，它们分别是预置和清零端，低电平有效。当SD=1且RD=0时(SD的非为0，RD的非为1，即在两个控制端口分别从外部输入的电平值，原因是低电平有效)，不论输入端D为何种状态，都会使Q=0，Q非=1，即触发器置0。
当SD=0且RD=1(SD的非为1，RD的非为0）时，Q=1，Q非=0，触发器置1，SD和RD通常又称为直接置1和置0端。我们设它们均已加入了高电平，不影响电路的工作。
输入信号在负跳变触发沿来到后就不必保持，原因在于即使原来的J、K信号变化,还要经一级与非门的延迟才能传输到G3和G4的输出端。
在此之前，触发器已由G12、G13、G22、G23的输出状态和触发器原先的状态决定翻转。所以这种触发器要求输入信号的维持时间极短，从而具有很高的抗干扰能力，且因缩短tCPH 可提高工作速度。
参考资料来源：百度百科--JK触发器
参考资料来源：百度百科--D触发器

处于1，这两个端是低电平有效，rd为置0端，sd为置1端，正常工作时应该全是1，rd=0，输出q=0，sd=0，输出q=1。
可以利用这两个端来进行联片，当符号上有非号时，信号是低电平有效，没有非号时，是高电平有效，使用时，总是使得触发器置位端无效，触发器才能正常使用，可以用别的信号加在这两个端上来控制触发器。

扩展资料：注意事项
JK触发器是数字电路触发器中的一种基本电路单元。JK触发器具有置0、置1、保持和翻转功能，在各类集成触发器中，JK触发器的功能最为齐全。在实际应用中，有很强的通用性，而且能灵活地转换其他类型的触发器。由JK触发器可以构成D触发器和T触发器。
若 Reset=0时：
J=1，K=0时，Qn+1=1；
J=0，K=1时，Qn+1=0；
J=K=0时，Qn+1=Qn；
J=K=1时，Qn+1=Qn；
带清零功能的主从下降沿JK触发器
若 Reset=1时：
不论J、K与Qn的值，Qn+1=0。

SD和RD接至基本RS触发器的输入端，它们分别是预置和清零端，低电平有效。当SD=1且RD=0时（SD的非为0，RD的非为1，即在两个控制端口分别从外部输入的电平值，原因是低电平有效），不论输入端D为何种状态，都会使Q=0，Q非=1，即触发器置0。

当SD=0且RD=1（SD的非为1，RD的非为0）时，Q=1，Q非=0，触发器置1，SD和RD通常又称为直接置1和置0端。设它们均已加入了高电平，不影响电路的工作。

扩展资料

JK触发器和触发器中最基本的RS触发器结构相似，其区别在于，RS触发器不允许R与S同时为1，而JK触发器允许J与K同时为1。当J与K同时变为1的同时，输出的值状态会反转。也就是说，原来是0的话，变成1；原来是1的话，变成0。 

D触发器（data flip-flop或delay flip-flop）由4个与非门组成，其中G1和G2构成基本RS触发器。电平触发的主从触发器工作时，必须在正跳沿前加入输入信号。如果在CP高电平期间输入端出现干扰信号，那么就有可能使触发器的状态出错。

而边沿触发器允许在CP触发沿来到前一瞬间加入输入信号。这样，输入端受干扰的时间大大缩短，受干扰的可能性就降低了。边沿D触发器也称为维持-阻塞边沿D触发器。边沿D触发器可由两个D触发器串联而成，但第一个D触发器的CP需要用非门反向。

参考资料来源：百度百科-JK触发器

参考资料来源：百度百科-D触发器

sd和rd连接到基本rs触发器的输入端。它们分别被预设和重置。低水平是有效的。当s d=1和rd=0时（sd的non为0，rd的non为1，即分别在两个控制端口从外部输入的电平值，因为低电平有效），无论输入d的状态如何，q=0，q non=1，即触发器设置为0。

当sd＝0和rd＝1时（sd不是1，rd不是0），q＝1，q不是0，触发器设置为1，sd和rd也被称为直接设置为1和设置为0。假设它们已被添加了高电平，这不会影响电路的工作。

扩展资料：

jk触发器的结构类似于rs触发器。区别在于r s触发器不允许r和s同时为1，而j k触发器允许j和k同时为1。当j和k同时变为1时，输出值状态将反转。也就是说，如果是0，就变成1；如果是1，就变成0。

d触发器（数据触发器或延迟触发器）由四个nand门组成，其中g1和g2构成基本的rs触发器。当电平触发主从触发器工作时，输入信号必须在正边之前加上。如果在高cp电平时输入端有干扰信号，则有可能使触发错误状态。

边缘触发器允许在cp触发器边缘到达之前添加输入信号。这样，大大缩短了输入干扰的时间，降低了干扰的可能性。边d触发器也称为保持块边d触发器。边缘d触发器可以由两个d触发器串联而成，但第一个d触发器的cp需要使用非门反向。

参考资料来源：

百度百科-JK触发器

百度百科-D触发器

RD：直接复位端或直接置“1”端。

SD：直接置位端或直接置“0”端。

RD：直接复位端或直接置“0”端。

SD：直接置位端或直接置“1”端。

楼上的那位搞反了吧。。

rd 异步置0 无视时钟信号
sd 异步置1 无视时钟信号

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普兰县13992303485： JK触发器和D触发器在现正常逻辑功能时sd\rd应处于什么状态 - ？
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普兰县13992303485： 这是一个jk触发器,请问RD撇与SD撇有什么作用,变了的话,会怎么样 - ？
钟离霄舒风： RD是直接清零端,SD是直接置＂1＂端.平时应该为低电平,当出现高电平时,触发器被清零或者被置成＂1＂,而无论jk端处于什么状态.

普兰县13992303485： RD SD 什么意思,什么作用？
钟离霄舒风： JK触发器 RD SD复位,置位. RD为0,Q=0, Q~= 1 SD为0,Q=1, Q~= 0

普兰县13992303485： JK触发器和D触发器 - ？
钟离霄舒风： 触发器是具有记忆功能的二进制存储器件,是各种时序逻辑电路的基本器件之一.其结构有同步、主从、维持阻塞等三种电路.触发器按功能可分为RS触发器,JK触发器,D触发器和T触发器等;按电路的触发方式可分为主—从触发器和边沿触...

普兰县13992303485： JK触发器置位,复位端功能测试时;RD=0,SD=1时和RD=1,SD=0时,Q和Q反的状态都是什么样的? - ？
钟离霄舒风： 恩,j-k触发器中sd是置1端,rd是置0端,当sd=0,rd=1时,不管j和k的状态是什么,q都是1

普兰县13992303485： JK触发器5个作用端(J,K,CP,Sd反,Rd反)的作用?请分别说明,谢谢!？
钟离霄舒风： j,k是输入端,cp是时钟信号输入,sd反是异步置位,rd反是复位端,亲,若满意,请采纳

普兰县13992303485： 某同学用JK触发器CC4027做三分频电路实验时,将其中的直接置0端Rd...？
钟离霄舒风： D触发器和JK触发器的逻辑功能: JK触发器再有时钟脉冲作用时(CP=1) 当J=0 K=0时状态保持不变 当J= 0 K=1时次态为0态 当J=1 K=0时次态为1态 当J=1 K=1时次态与现态相反 D触发器(由与非门构成):当D=1时,Q=0;当D=0时...