计数器为什么可以作为分频器?
假设各触发器均处于0态,根据电路结构特点以及D触发器工作特性,不难得到其状态图和时序图。其中虚线是考虑触发器的传输延迟时间tpd后的波形。
由状态图可以清楚地看到,从初始状态000(由清零脉冲所置)开始,每输入一个计数脉冲,计数器的状态按二进制递增(加1),输入第8个计数脉冲后,计数器又回到000状态。因此它是23进制加计数器,也称模八(M=8)加计数器。
从时序图可以清楚地看到Q0,Q1,Q2的周期分别是计数脉冲(CP)周期的2倍,4倍、8倍,也就是说Q0,Q1,Q2,分别对CP波形进行了二分频,四分频,八分频,因而计数器也可作为分频器。
扩展资料
计数器不仅能记录输入时钟脉冲的个数,还可以实现分频、定时、产生节拍脉冲和脉冲序列等。例如,计算机中的时序发生器、分频器、指令计数器等都要使用计数器。
计数器的种类很多。按时钟脉冲输入方式的不同,可分为同步计数器和异步计数器;按进位体制的不同,可分为二进制计数器和非二进制计数器;按计数过程中数字增减趋势的不同,可分为加计数器、减计数器和可逆计数器。
参考资料来源:百度百科-二进制计数器
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达姚宜利: 就你问的问题我有点搞不懂. 你是说计数器的时钟需要分频,还是说计数器用来当分频器用? 要是问为什么可以用来当分频器用,原因很简单,比如输入脉冲为120Hz,一个4位二进制计数器,它的Q0端,就是最低位端的变化频率是随时钟脉冲频率一样变化的,而Q0每变化两次Q1会变化一次,也就是说Q1的频率为60Hz,以此类推,Q2就是30Hz,Q3就是15Hz. 有不懂的地方随时回复我. 希望我的回答能帮助到你
邳州市18427593936: 在verilog分频设计中,为什么计数器最高位可作为分频的时钟输出呢? - ?
达姚宜利: 形象一点的话你可以仿真看一下,把你的计数器位数展开,你会看到越是高位,他的翻转频率越低,因为每高一位就相当于一次2分频,用计数器最高位其实就相当于进行了高次的二分频,从而得到你想要的低频率时钟.
邳州市18427593936: 数字电路中分频器的工作原理 - ?
达姚宜利: 所谓“分频”,就是把输入信号的频率变成成倍数地低于输入频率的输出信号.文献资料上所谓用计数器的方法做“分频器”的方法,只是众多方法中的一种.它的原理是:把输入的信号作为计数脉冲,由于计数器的输出端口是按一定规律输出脉冲的,所以对不同的端口输出的信号脉冲,就可以看作是对输入信号的”分频“.至于分频频率是怎样的,由选用的计数器所决定.如果是十进制的计数器那就是十分频,如果是二进制的计数器那就是二分频,还有四进制、八进制、十六进制等等.以此类推.
邳州市18427593936: 计数器能否做分频器 - ?
达姚宜利: 当然可以,分频器就是通过计数累加到一定值后进行电平翻转
邳州市18427593936: 分频和计数有何异同? - ?
达姚宜利: 分频是把一个交流信号按照特定的比例降频,如二分频就是把频率降到原来的二分之一、三分频就是把频率降到原来的三分之一,计数则是在一段时间内对某个交流信号的脉冲数进行计数.对计数器的计数输出端进行与可以实现各种比例的分频,因此计数器也是最常用的一种分频器.
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达姚宜利: 分频之后可以使输入的速度降低,单片机可以更好的响应,否则振荡频率巨高,信号持续的周期过短,单片机怎么响应?计数程序可以设定每采集一个信号对应着多少个频率振荡,这对现实频率的采集结果完全没有影响,而且使得单片机工作起...
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达姚宜利: 从电路结构来看,分频器本质上是由电容器和电感线圈构成的LC滤波网络,高音通道是高通滤波器,它只让高频信号通过而阻止低频信号;低音通道正好相反,它只让低音通过而阻止高频信号;中音通道则是一个带通滤波器,除了一低一高两...
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达姚宜利: 首先:分频,就是将频率缩小; 比如之前的频率是10Hz(时钟周期为0.1),那2分频后就是5Hz(时钟周期为0.2) 好,那我问你,如果时钟频率是10Hz,1秒钟内有多少个时钟呢(就是clk cycle是怎样的呢);显然画出的波形就是1秒钟内有10个...
邳州市18427593936: 数电计数器这个预置数和分频比是怎么求得?比如这个题的预置数和分频比如何求,答案也有只求解释 - ?
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邳州市18427593936: 数字电路里的几进制几分频是什么意思 - ?
达姚宜利: 分频就是用同一个时钟信号通过一定的电路结构转变成不同频率的时钟信号. 二分频就是通过有分频作用的电路结构,在时钟每触发2个周期时,电路输出1个周期信号. 比如用一个脉冲时钟触发一个计数器,计数器每计2个数就清零一次并输出1个脉冲.